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  • Xilinx高性能NVMe Host IP和PCIe 3.0软核IP/4通道DMA/AXI4接口
    NVMe AXI4 Host Controller IP 1.介绍 NVMe AXI4 Host Controller IP可以连接高速存储PCIe SSD,无需CPU,自动加速处理所有的NVMe协议命令,具备独立的数据写入和读取AXI4接口,不但适用高性能、顺序访问的应用,也适用于随机访问的应用,同时结合外部存储器(比如DDR),使得Host端的数据访问管理更加灵活。 NVMe是基于PCIe之上
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    10/04 10:38
  • 基于PCIe(XDMA)的1-32路信号采集与回放, 视频/AD/光纤/支持PR over PCIe
    基于PCIe(XDMA)的多路(1-32路)信号采集与回放子系统 多路视频、AD、光纤等信号,支持PR over PCIe 1、概述 多路信号采集与回放子系统可以实时采集1-32路视频、AD、光纤等信号,并存储到采集队列中,借助高效的硬实时数据帧出入队列管理和PCIe C2H DMA引擎,将采集到的信号帧实时传递到上位机采集缓冲区。在超带宽视频采集情况下,支持采集丢帧操作,后续视频可以正常采集。
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    10/04 10:35
  • 基于FPGA的便携式DDS信号发生器与示波器
    利用赛灵思公司 A7 系列板卡 EG01、AD9226 模块和 DAC904 模块, 制作一个便携式、宽频带的示波器和 DDS 信号源,两者二合一,既能产生信号波形又可以实现示波器的基本功能。
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  • NXP Wi-Fi & Bluetooth 产品全场景选型与开发指南(2025 版)
    本文介绍了NXP Wi-Fi & Bluetooth产品的分类、核心特性和选型要点,并提供了详细的开发资源和技术支持路径。涵盖了物联网(IoT)、无线微控制器(Hostless)和汽车电子产品三大应用场景,针对不同需求推荐了具体产品。文章还提供了产品参数表、开发环境搭建方法和技术支持渠道,帮助工程师高效选型并快速开发。
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    09/29 14:43
  • 【FPGA 开发分享】如何在 Vivado 中使用 PLL IP 核生成多路时钟
    EsteemPCB Academy 是一个专注于 FPGA、嵌入式系统与硬件开发的技术学习平台,致力于通过通俗易懂的课程内容,帮助工程师和学习者快速掌握前沿技术。 在开始今天的主题之前,我先抛出一个问题。我们知道,目前使用的 AX7020 开发板自带一颗 50 MHz 的 PLSysRef 时钟。 那么,如果某个应用需要 100 MHz、250 MHz 甚至更高频率的时钟,该怎么实现呢?这时就需要
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    09/29 09:38